AI駆動開発時代のモデルベースFPGA実装・検証【オンライン無料体験会】
| 開始時間 | 終了時間 |
|---|---|
| 2026 年 7 月 28 日, 00:30 EDT | 2026 年 7 月 28 日, 04:30 EDT |
概要
生成AIやエージェントAIの進化により、コードを短時間で生成できるようになり、SW/HWの開発スタイルは大きく変化しつつあります。一方で、実際のFPGA/ASIC開発では、固定小数点化、パイプライン遅延、スループット、回路規模などのトレードオフ最適化や、システムレベルでの検証が課題となるケースがあります。
モデルベースデザインは、シミュレーションによる事前検証、アルゴリズムと実装の整合性確認、HDL/FPGA等価性検証などを通じて、こうした生成AI活用時の課題を補完し、FPGA/ASIC開発の品質向上と効率化を支援します。
本体験会では、モデルベースデザインと生成AIを組み合わせた活用イメージをご紹介するとともに、実際にモデルベースデザインによるHDL設計・検証フローを体験いただきます。
体験パートでは、Simulinkモデル作成からHDLコード生成、固定小数点化、テストベンチ生成によるHDL/FPGA等価性検証までの基本操作を、MATLABとSimulinkを実際に操作しながら学んでいただけます。
ハイライト
- AI時代におけるFPGA/ASIC開発フローの変化
- モデルベースデザインと生成AIの活用イメージ
- HDL生成のための設定と手順
- HDL生成に対応したSimulinkモデルの作成例
- 固定小数点化とシミュレーション
- 最適化(リソース共有、パイプライン)機能
- HDLコード等価性検証およびFPGAによる検証高速化
※AI関連機能の操作体験は含まれません。
参加対象者
HDL Coder 未導入で今後導入を検討されている方
※オンラインで実施いたします。参加者には事前にMATLABを体験できる評価版を発行します。MATLABを利用可能なPCを各自ご用意下さい。講師の画面とご自身の画面を見られるよう2画面でのご利用を推奨いたします。聴講だけのご参加も可能です。
※定員等の都合により、参加をお断りする場合があります。あらかじめご了承ください。
※既に導入済みの方は、2026年8月20~21日に実施される技術トレーニング「HDL Coder による HDL コード生成」コースをご受講ください。
講演者について
アジェンダ
| 時間 | タイトル |
| 13:00 | 開場(オンラインオープン) |
| 13:30 | 体験会開始 |
| 17:30 | 体験会終了、Q&A |
対象製品
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